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基于ASIC的H．264编码器设计及其ADSP验证策略

简介：提出了H．264／AVC硬件编码器的一种3级流水结构，以此来提高硬件加速电路的处理能力和利用效率。鉴于H．264编码芯片验证的复杂性，还提出了一种基于ADSP-BF537的新型多媒体SoC验证平台，并讨论了如何利用BF537，对H．264编码芯片进行全面、高效的软硬件协同验证。
标签： H.264编码器硬件加速器 ADSP-BF5 37 软硬件协同验证 SoC

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